; NOTE: Assertions have been autogenerated by utils/update_llc_test_checks.py
; RUN: llc -mtriple=riscv32 -mattr=+experimental-v -riscv-v-vector-bits-min=128 -riscv-v-fixed-length-vector-lmul-max=2 -verify-machineinstrs < %s | FileCheck %s --check-prefixes=LMULMAX2-RV32
; RUN: llc -mtriple=riscv64 -mattr=+experimental-v -riscv-v-vector-bits-min=128 -riscv-v-fixed-length-vector-lmul-max=2 -verify-machineinstrs < %s | FileCheck %s --check-prefixes=LMULMAX2-RV64
; RUN: llc -mtriple=riscv32 -mattr=+experimental-v -riscv-v-vector-bits-min=128 -riscv-v-fixed-length-vector-lmul-max=1 -verify-machineinstrs < %s | FileCheck %s --check-prefixes=LMULMAX1-RV32
; RUN: llc -mtriple=riscv64 -mattr=+experimental-v -riscv-v-vector-bits-min=128 -riscv-v-fixed-length-vector-lmul-max=1 -verify-machineinstrs < %s | FileCheck %s --check-prefixes=LMULMAX1-RV64

define void @bitreverse_v8i16(<8 x i16>* %x, <8 x i16>* %y) {
; LMULMAX2-RV32-LABEL: bitreverse_v8i16:
; LMULMAX2-RV32:       # %bb.0:
; LMULMAX2-RV32-NEXT:    vsetivli zero, 8, e16, m1, ta, mu
; LMULMAX2-RV32-NEXT:    vle16.v v25, (a0)
; LMULMAX2-RV32-NEXT:    vsrl.vi v26, v25, 8
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; LMULMAX2-RV32-NEXT:    vor.vv v25, v25, v26
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; LMULMAX2-RV32-NEXT:    vand.vx v25, v25, a1
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; LMULMAX2-RV32-NEXT:    vand.vx v26, v25, a1
; LMULMAX2-RV32-NEXT:    vadd.vv v26, v26, v26
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; LMULMAX2-RV32-NEXT:    vand.vx v25, v25, a1
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; LMULMAX2-RV32-NEXT:    ret
;
; LMULMAX2-RV64-LABEL: bitreverse_v8i16:
; LMULMAX2-RV64:       # %bb.0:
; LMULMAX2-RV64-NEXT:    vsetivli zero, 8, e16, m1, ta, mu
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; LMULMAX2-RV64-NEXT:    vsrl.vi v26, v25, 8
; LMULMAX2-RV64-NEXT:    vsll.vi v25, v25, 8
; LMULMAX2-RV64-NEXT:    vor.vv v25, v25, v26
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; LMULMAX2-RV64-NEXT:    vand.vx v25, v25, a1
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; LMULMAX2-RV64-NEXT:    ret
;
; LMULMAX1-RV32-LABEL: bitreverse_v8i16:
; LMULMAX1-RV32:       # %bb.0:
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; LMULMAX1-RV32-NEXT:    vsll.vi v25, v25, 8
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; LMULMAX1-RV32-NEXT:    vand.vx v25, v25, a1
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; LMULMAX1-RV32-NEXT:    lui a1, 5
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; LMULMAX1-RV32-NEXT:    vand.vx v26, v25, a1
; LMULMAX1-RV32-NEXT:    vadd.vv v26, v26, v26
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; LMULMAX1-RV32-NEXT:    ret
;
; LMULMAX1-RV64-LABEL: bitreverse_v8i16:
; LMULMAX1-RV64:       # %bb.0:
; LMULMAX1-RV64-NEXT:    vsetivli zero, 8, e16, m1, ta, mu
; LMULMAX1-RV64-NEXT:    vle16.v v25, (a0)
; LMULMAX1-RV64-NEXT:    vsrl.vi v26, v25, 8
; LMULMAX1-RV64-NEXT:    vsll.vi v25, v25, 8
; LMULMAX1-RV64-NEXT:    vor.vv v25, v25, v26
; LMULMAX1-RV64-NEXT:    lui a1, 1
; LMULMAX1-RV64-NEXT:    addiw a1, a1, -241
; LMULMAX1-RV64-NEXT:    vand.vx v26, v25, a1
; LMULMAX1-RV64-NEXT:    vsll.vi v26, v26, 4
; LMULMAX1-RV64-NEXT:    lui a1, 15
; LMULMAX1-RV64-NEXT:    addiw a1, a1, 240
; LMULMAX1-RV64-NEXT:    vand.vx v25, v25, a1
; LMULMAX1-RV64-NEXT:    vsrl.vi v25, v25, 4
; LMULMAX1-RV64-NEXT:    vor.vv v25, v25, v26
; LMULMAX1-RV64-NEXT:    lui a1, 3
; LMULMAX1-RV64-NEXT:    addiw a1, a1, 819
; LMULMAX1-RV64-NEXT:    vand.vx v26, v25, a1
; LMULMAX1-RV64-NEXT:    vsll.vi v26, v26, 2
; LMULMAX1-RV64-NEXT:    lui a1, 13
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; LMULMAX1-RV64-NEXT:    lui a1, 5
; LMULMAX1-RV64-NEXT:    addiw a1, a1, 1365
; LMULMAX1-RV64-NEXT:    vand.vx v26, v25, a1
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; LMULMAX1-RV64-NEXT:    lui a1, 11
; LMULMAX1-RV64-NEXT:    addiw a1, a1, -1366
; LMULMAX1-RV64-NEXT:    vand.vx v25, v25, a1
; LMULMAX1-RV64-NEXT:    vsrl.vi v25, v25, 1
; LMULMAX1-RV64-NEXT:    vor.vv v25, v25, v26
; LMULMAX1-RV64-NEXT:    vse16.v v25, (a0)
; LMULMAX1-RV64-NEXT:    ret
  %a = load <8 x i16>, <8 x i16>* %x
  %b = load <8 x i16>, <8 x i16>* %y
  %c = call <8 x i16> @llvm.bitreverse.v8i16(<8 x i16> %a)
  store <8 x i16> %c, <8 x i16>* %x
  ret void
}
declare <8 x i16> @llvm.bitreverse.v8i16(<8 x i16>)

define void @bitreverse_v4i32(<4 x i32>* %x, <4 x i32>* %y) {
; LMULMAX2-RV32-LABEL: bitreverse_v4i32:
; LMULMAX2-RV32:       # %bb.0:
; LMULMAX2-RV32-NEXT:    vsetivli zero, 4, e32, m1, ta, mu
; LMULMAX2-RV32-NEXT:    vle32.v v25, (a0)
; LMULMAX2-RV32-NEXT:    vsrl.vi v26, v25, 8
; LMULMAX2-RV32-NEXT:    lui a1, 16
; LMULMAX2-RV32-NEXT:    addi a1, a1, -256
; LMULMAX2-RV32-NEXT:    vand.vx v26, v26, a1
; LMULMAX2-RV32-NEXT:    vsrl.vi v27, v25, 24
; LMULMAX2-RV32-NEXT:    vor.vv v26, v26, v27
; LMULMAX2-RV32-NEXT:    vsll.vi v27, v25, 8
; LMULMAX2-RV32-NEXT:    lui a1, 4080
; LMULMAX2-RV32-NEXT:    vand.vx v27, v27, a1
; LMULMAX2-RV32-NEXT:    vsll.vi v25, v25, 24
; LMULMAX2-RV32-NEXT:    vor.vv v25, v25, v27
; LMULMAX2-RV32-NEXT:    vor.vv v25, v25, v26
; LMULMAX2-RV32-NEXT:    lui a1, 61681
; LMULMAX2-RV32-NEXT:    addi a1, a1, -241
; LMULMAX2-RV32-NEXT:    vand.vx v26, v25, a1
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; LMULMAX2-RV32-NEXT:    vand.vx v25, v25, a1
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; LMULMAX2-RV32-NEXT:    lui a1, 209715
; LMULMAX2-RV32-NEXT:    addi a1, a1, 819
; LMULMAX2-RV32-NEXT:    vand.vx v26, v25, a1
; LMULMAX2-RV32-NEXT:    vsll.vi v26, v26, 2
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; LMULMAX2-RV32-NEXT:    vadd.vv v26, v26, v26
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; LMULMAX2-RV32-NEXT:    vand.vx v25, v25, a1
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; LMULMAX2-RV32-NEXT:    vse32.v v25, (a0)
; LMULMAX2-RV32-NEXT:    ret
;
; LMULMAX2-RV64-LABEL: bitreverse_v4i32:
; LMULMAX2-RV64:       # %bb.0:
; LMULMAX2-RV64-NEXT:    vsetivli zero, 4, e32, m1, ta, mu
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; LMULMAX2-RV64-NEXT:    vand.vx v26, v25, a1
; LMULMAX2-RV64-NEXT:    vsll.vi v26, v26, 4
; LMULMAX2-RV64-NEXT:    lui a1, 241
; LMULMAX2-RV64-NEXT:    addiw a1, a1, -241
; LMULMAX2-RV64-NEXT:    slli a1, a1, 12
; LMULMAX2-RV64-NEXT:    addi a1, a1, 240
; LMULMAX2-RV64-NEXT:    vand.vx v25, v25, a1
; LMULMAX2-RV64-NEXT:    vsrl.vi v25, v25, 4
; LMULMAX2-RV64-NEXT:    vor.vv v25, v25, v26
; LMULMAX2-RV64-NEXT:    lui a1, 209715
; LMULMAX2-RV64-NEXT:    addiw a1, a1, 819
; LMULMAX2-RV64-NEXT:    vand.vx v26, v25, a1
; LMULMAX2-RV64-NEXT:    vsll.vi v26, v26, 2
; LMULMAX2-RV64-NEXT:    lui a1, 205
; LMULMAX2-RV64-NEXT:    addiw a1, a1, -819
; LMULMAX2-RV64-NEXT:    slli a1, a1, 12
; LMULMAX2-RV64-NEXT:    addi a1, a1, -820
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; LMULMAX2-RV64-NEXT:    vor.vv v25, v25, v26
; LMULMAX2-RV64-NEXT:    lui a1, 349525
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; LMULMAX2-RV64-NEXT:    vand.vx v26, v25, a1
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; LMULMAX2-RV64-NEXT:    lui a1, 171
; LMULMAX2-RV64-NEXT:    addiw a1, a1, -1365
; LMULMAX2-RV64-NEXT:    slli a1, a1, 12
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; LMULMAX2-RV64-NEXT:    vsrl.vi v25, v25, 1
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; LMULMAX2-RV64-NEXT:    vse32.v v25, (a0)
; LMULMAX2-RV64-NEXT:    ret
;
; LMULMAX1-RV32-LABEL: bitreverse_v4i32:
; LMULMAX1-RV32:       # %bb.0:
; LMULMAX1-RV32-NEXT:    vsetivli zero, 4, e32, m1, ta, mu
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; LMULMAX1-RV32-NEXT:    vsrl.vi v26, v25, 8
; LMULMAX1-RV32-NEXT:    lui a1, 16
; LMULMAX1-RV32-NEXT:    addi a1, a1, -256
; LMULMAX1-RV32-NEXT:    vand.vx v26, v26, a1
; LMULMAX1-RV32-NEXT:    vsrl.vi v27, v25, 24
; LMULMAX1-RV32-NEXT:    vor.vv v26, v26, v27
; LMULMAX1-RV32-NEXT:    vsll.vi v27, v25, 8
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; LMULMAX1-RV32-NEXT:    vand.vx v27, v27, a1
; LMULMAX1-RV32-NEXT:    vsll.vi v25, v25, 24
; LMULMAX1-RV32-NEXT:    vor.vv v25, v25, v27
; LMULMAX1-RV32-NEXT:    vor.vv v25, v25, v26
; LMULMAX1-RV32-NEXT:    lui a1, 61681
; LMULMAX1-RV32-NEXT:    addi a1, a1, -241
; LMULMAX1-RV32-NEXT:    vand.vx v26, v25, a1
; LMULMAX1-RV32-NEXT:    vsll.vi v26, v26, 4
; LMULMAX1-RV32-NEXT:    lui a1, 986895
; LMULMAX1-RV32-NEXT:    addi a1, a1, 240
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; LMULMAX1-RV64-NEXT:    ret
  %a = load <4 x i32>, <4 x i32>* %x
  %b = load <4 x i32>, <4 x i32>* %y
  %c = call <4 x i32> @llvm.bitreverse.v4i32(<4 x i32> %a)
  store <4 x i32> %c, <4 x i32>* %x
  ret void
}
declare <4 x i32> @llvm.bitreverse.v4i32(<4 x i32>)

define void @bitreverse_v2i64(<2 x i64>* %x, <2 x i64>* %y) {
; LMULMAX2-RV32-LABEL: bitreverse_v2i64:
; LMULMAX2-RV32:       # %bb.0:
; LMULMAX2-RV32-NEXT:    vsetivli zero, 2, e64, m1, ta, mu
; LMULMAX2-RV32-NEXT:    vle64.v v25, (a0)
; LMULMAX2-RV32-NEXT:    addi a1, zero, 56
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; LMULMAX2-RV32-NEXT:    vand.vx v27, v27, a3
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; LMULMAX2-RV32-NEXT:    lui a4, 4080
; LMULMAX2-RV32-NEXT:    vand.vx v27, v27, a4
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; LMULMAX2-RV32-NEXT:    vor.vv v27, v28, v27
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; LMULMAX2-RV32-NEXT:    vadd.vv v26, v26, v26
; LMULMAX2-RV32-NEXT:    lui a1, 699051
; LMULMAX2-RV32-NEXT:    addi a1, a1, -1366
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;
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; LMULMAX2-RV64:       # %bb.0:
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; LMULMAX2-RV64-NEXT:    lui a3, 4080
; LMULMAX2-RV64-NEXT:    vand.vx v27, v27, a3
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; LMULMAX2-RV64-NEXT:    addi a1, a1, -819
; LMULMAX2-RV64-NEXT:    slli a1, a1, 12
; LMULMAX2-RV64-NEXT:    addi a1, a1, -819
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  store <16 x i16> %c, <16 x i16>* %x
  ret void
}
declare <16 x i16> @llvm.bitreverse.v16i16(<16 x i16>)

define void @bitreverse_v8i32(<8 x i32>* %x, <8 x i32>* %y) {
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  %b = load <8 x i32>, <8 x i32>* %y
  %c = call <8 x i32> @llvm.bitreverse.v8i32(<8 x i32> %a)
  store <8 x i32> %c, <8 x i32>* %x
  ret void
}
declare <8 x i32> @llvm.bitreverse.v8i32(<8 x i32>)

define void @bitreverse_v4i64(<4 x i64>* %x, <4 x i64>* %y) {
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